Veranstaltung/VHDL und FPGAs Teil I: Unterschied zwischen den Versionen
Aus LaborWiki
(→Facts) |
(→Facts) |
||
| Zeile 1: | Zeile 1: | ||
==Facts== | ==Facts== | ||
* Was: Einfuehrung in VHDL und FPGAs | * Was: Einfuehrung in VHDL und FPGAs | ||
* Wann: Do. 31.8.2006 (war 24.8.2006) | * Wann: Do. 31.8.2006 (war 24.8.2006) 19:00 | ||
* Wo: [[Wegbeschreibung|Labor]] | * Wo: [[Wegbeschreibung|Labor]] | ||
* Wer: Joerg Bornschein | * Wer: Joerg Bornschein | ||
Version vom 31. August 2006, 15:49 Uhr
Facts
- Was: Einfuehrung in VHDL und FPGAs
- Wann: Do. 31.8.2006 (war 24.8.2006) 19:00
- Wo: Labor
- Wer: Joerg Bornschein
FPGAs bieten einen kostenguenstigen Einstieg in die Hardwareentwicklung.
Analog zur sequentiellen Programmierung, bei der man bevorzugt Hochsprachen einsetzt um Algoritmen zu beschreiben, verwendet man synthesefaehige Hochsprachen wie VHDL oder Verilog um Hardware zu entwickeln.
Der Vortrag behandelt vorraussichtlich die Folgenden Themen:
- Fähigkeiten und Aufbau marktüblicher FPGAs
- Einfuehrung VHDL: Syntax, Typen und Komponenten
- Einfuehrung VHDL: Concurrents statments, Processes
- Synthese und Implementation (am Beispiel der Xilinx Entwicklertools)
- Beispiel code
- Design-Tips fuer digitale Schaltungen